【站僕】摩檸Morning>試卷(2016/03/24)

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98 年 - 098年升官等簡任高等電子電路學研究(包括類比與數位)#47669 

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【非選題】
1.
一、

【題組】⑴試說明 MOSFET 元件中造成通道長度調變(channel-length modulation)效應及基 底(body)效應的物理機制。(8 分)


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【非選題】
2.【題組】 ⑵試繪出 MOSFET 元件之四端點(source, drain, gate, body)小信號等效電路模型, 此模型須包含⑴中的二種效應,並將元件內各寄生電容一併納入。(7 分)

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【非選題】
3.【題組】 ⑶試將⑵中之小信號電路模型作適當之簡化,以求得MOSFET元件之單位增益頻寬 (fT)之表示式。(10 分)

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【非選題】
4.
二、圖一所示為一由雙極性電晶體(BJT)Qp , QN所構成之B類放大器,其輸出負載電阻 為RL,所有電容效應皆可忽略。 

【題組】 ⑴當輸入信號(設為一弦波)甚小及過大時,此放大器輸出波形皆會有失真(distortion) 現象,試分別解釋其原因。(10 分)


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【非選題】
5.【題組】 ⑵忽略⑴中的失真現象,並設輸出信號v0(t)為一振幅為Vom之弦波,請計算此放大器 之效率(η),並以Vcc , Vom等參數表示之。(5 分)

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【非選題】
6.【題組】 ⑶同⑵之狀況,試求消耗於QP及QN中之總平均功率(PD)。(以Vcc , Vom及RL表示 之)(5 分)

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7.【題組】 ⑷此放大器於理想狀況時最大效率(ηmax)為何?當總平均消耗功率為最大(PD=PD max) 時效率又是多少?(5 分)

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【非選題】
8.
三、

【題組】⑴圖二①、②所示,為動態CMOS Latch電路(又稱為C2MOS)之二種可能之實現 方法,其中 φ 及 為二互為反相之時脈(clock)信號。此二電路何者之特性較佳? 試解釋之。(10 分)


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【非選題】
9.【題組】 ⑵試用⑴中特性較佳之 CMOS Latch 電路作為基本單元,建構一動態 D 型正反器(Flip- Flop)。(10 分) 

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【非選題】
10.
四、圖三所示為一雙模數除頻器電路,“MC”為模數(Modulus)控制信號。

【題組】 ⑴試求當 MC 分別為“0”及“1”時,其除頻比。(7 分)


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【非選題】
11.【題組】 ⑵“fin”為一週期性對稱方波時脈(clock)信號,試分別繪出當MC為“0”及“1”時, Q1, Q2, Q3之波形圖。(8 分) 

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【非選題】
12.五、⑴試分別繪出一具有三個輸入端(A, B, C)之 CMOS 及 pseudo-NMOS NAND 閘電 路圖。(8 分)

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【非選題】
13. ⑵試比較以矽 VLSI 製程實現上述二種電路時之優、缺點。(7 分)

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懸賞詳解

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21.文人常寄情山水間,下列有關「山對文人所產生的作用」何者敘述錯誤? (A)孔子:「登泰山而小天下」─山開拓其胸襟與視野 (B)李白:「相看兩...

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