76.有關 Verilog HDL 語法，下列敘述何者正確？
(A)4'b1101 表示 4bit 二進位數 1101
(B)12'h123 表示 1 2bit 十六進位數 123
(C)Verilog 中的位元相反運算為!符號，而~是邏輯 not 的意思，不會對每個位元進行相反動作
(D)always@(posedge clock)表示正緣 clock(0→1)會執行區塊敘述。

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【站僕】摩檸Morning：有沒有達人來解釋一下?

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