30 下列何者不是 C++程式語言具有的性質？ (A)封裝（encapsulation） (B)繼承（inheritance） (C)多型（polymorphism） (D)垃圾收集（garbage collection）

30 下列何者不是 C++程式語言具有的性質？
(A)封裝（encapsulation）
(B)繼承（inheritance）
(C)多型（polymorphism）
(D)垃圾收集（garbage collection）

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統計： A(32), B(43), C(35), D(1228), E(0) #682784

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Danele Lin

B1 · 2017/03/19

#1673926

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5 若欲使用 Verilog 語言合成（synthesize）出與下圖相同功能的電路，則下列各 Verilog 模組何者正確？ (A)module TestCircuit (A, B, C, clock, X, Y);input A;input B;input C;input clock;output X;output Y;reg X; reg Y;always @(posedge clock) X <= A | B;always @(B or C) Y = B & C; endmodule (B)module TestCircuit (A, B, C, clock, X, Y);input A;input B;input C;input clock;output X;output Y;reg X; reg Y;always @(posedge clock) X <= A | B;always @(posedge clock) Y = B & C; endmodule (C)module TestCircuit (A, B, C, clock, X, Y);input A;input B;input C;input clock;output X;output Y;reg X; wire Y;always @(posedge clock) X = A | B;always @(posedge clock) Y = B & C;endmodule (D)module TestCircuit (A, B, C, clock, X, Y);input A;input B;input C;input clock;output X;output Y;reg X; reg Y;always @(posedge clock) X <= A+B;always @(B or C) Y = B * C;endmodule D X Y A B C clock

30 下列何者不是 C++程式語言具有的性質？
(A)封裝（encapsulation）
(B)繼承（inheritance）
(C)多型（polymorphism）
(D)垃圾收集（garbage collection）

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