37 關於資訊安全的維護，下列何種性質，其所指的是資訊在利用、傳輸、儲存等過程中確保其不被竄改、遺失、缺損？ (A)保密性（confidentiality）(B)完整性（integrity） (C)責任性（accountability）(D)可用性（availability）

37 關於資訊安全的維護，下列何種性質，其所指的是資訊在利用、傳輸、儲存等過程中確保其不被竄改、遺失、缺損？
(A)保密性（confidentiality）
(B)完整性（integrity）
(C)責任性（accountability）
(D)可用性（availability）

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B1 · 2019/03/29

#3268780

資訊安全三要素 CIA：機密性（Co...

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5 若欲使用 Verilog 語言合成（synthesize）出與下圖相同功能的電路，則下列各 Verilog 模組何者正確？ (A)module TestCircuit (A, B, C, clock, X, Y);input A;input B;input C;input clock;output X;output Y;reg X; reg Y;always @(posedge clock) X <= A | B;always @(B or C) Y = B & C; endmodule (B)module TestCircuit (A, B, C, clock, X, Y);input A;input B;input C;input clock;output X;output Y;reg X; reg Y;always @(posedge clock) X <= A | B;always @(posedge clock) Y = B & C; endmodule (C)module TestCircuit (A, B, C, clock, X, Y);input A;input B;input C;input clock;output X;output Y;reg X; wire Y;always @(posedge clock) X = A | B;always @(posedge clock) Y = B & C;endmodule (D)module TestCircuit (A, B, C, clock, X, Y);input A;input B;input C;input clock;output X;output Y;reg X; reg Y;always @(posedge clock) X <= A+B;always @(B or C) Y = B * C;endmodule D X Y A B C clock

37 關於資訊安全的維護，下列何種性質，其所指的是資訊在利用、傳輸、儲存等過程中確保其不被竄改、遺失、缺損？
(A)保密性（confidentiality）
(B)完整性（integrity）
(C)責任性（accountability）
(D)可用性（availability）

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(B)完整性（integrity）
(C)責任性（accountability）
(D)可用性（availability）