39 因為雲端運算的發展，下列那項攻擊或資安事件較以往更為嚴重？ (A)阻斷服務攻擊（DoS）(B)分散式阻斷服務攻擊（DDoS） (C)網路釣魚（phishing）(D)資料外洩（data leakage）

39 因為雲端運算的發展，下列那項攻擊或資安事件較以往更為嚴重？
(A)阻斷服務攻擊（DoS）
(B)分散式阻斷服務攻擊（DDoS）
(C)網路釣魚（phishing）
(D)資料外洩（data leakage）

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統計： A(19), B(103), C(43), D(210), E(0) #682793

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ccalb

B2 · 2015/07/08

#1114673

題目是:下列那項攻擊或資安事件較以往更為嚴重？

D 資料外洩

努力

B1 · 2015/05/18

#1062283

不理解 ?
為何不是Dos
癱瘓網站應該比竊取容易啊 ?

努力

B3 · 2015/07/13

#1117353

感謝是我誤會了 orz

5 若欲使用 Verilog 語言合成（synthesize）出與下圖相同功能的電路，則下列各 Verilog 模組何者正確？ (A)module TestCircuit (A, B, C, clock, X, Y);input A;input B;input C;input clock;output X;output Y;reg X; reg Y;always @(posedge clock) X <= A | B;always @(B or C) Y = B & C; endmodule (B)module TestCircuit (A, B, C, clock, X, Y);input A;input B;input C;input clock;output X;output Y;reg X; reg Y;always @(posedge clock) X <= A | B;always @(posedge clock) Y = B & C; endmodule (C)module TestCircuit (A, B, C, clock, X, Y);input A;input B;input C;input clock;output X;output Y;reg X; wire Y;always @(posedge clock) X = A | B;always @(posedge clock) Y = B & C;endmodule (D)module TestCircuit (A, B, C, clock, X, Y);input A;input B;input C;input clock;output X;output Y;reg X; reg Y;always @(posedge clock) X <= A+B;always @(B or C) Y = B * C;endmodule D X Y A B C clock

39 因為雲端運算的發展，下列那項攻擊或資安事件較以往更為嚴重？
(A)阻斷服務攻擊（DoS）
(B)分散式阻斷服務攻擊（DDoS）
(C)網路釣魚（phishing）
(D)資料外洩（data leakage）

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