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113年 - 113 地方政府公務特種考試_三等_電力工程、電子工程:電子學#124569
> 申論題
五、試以 CMOS 邏輯(CMOS logic)電路實現布林函數 Y =
之電路圖。
相關申論題
(一)請求出開路增益(open-loop gain) v 大小 A =
#529766
(二)如果 v2 = 0 V , v3 = 4 V,請求出 v1,差動輸入訊號 ()與共模()訊號。
#529767
二、圖二為 CMOS 放大器,假設採用 0.18-μm 製程且所有電晶體之 W/L = 7.2 μm/0.36 μm, = 387 μA/V2,=86 μA/V2,=100 μA, 爾利電壓(Early voltage)NMOS = 5 V/μm 與 PMOS =6 V/μm, 求電晶體 Q1 的轉導值,電晶體 Q1、Q2 的輸出電阻,增益大 小()。
#529768
(一)假設電晶體在集極(collector)直流電流= 1 mA 條件下,= 0.7 V ,試求在射極(emitter)端點的直流電壓
#529769
(二)求輸入電晶體的轉導值(其中=0.025 V )
#529770
(三)求兩顆電晶體的集極電流。
#529771
四、圖四為共源級放大器( common-source amplifier ),其中訊號源電阻= 20 kΩ ,負載電阻= 10 kΩ ,電晶體轉導值=2 mA/V ,電晶體 輸出電阻 ro = 10 kΩ ,電晶體內部電容=20 fF , =5 fF ,採用米勒等效電路(Miller equivalent circuit)方法求出 3-dB 頻寬()與零點頻 率()。
#529772
(二)當 vA = vB = 5 V 時,vO = ?(15 分)
#570154
(一)當 vA = vB = 0 V 時,vO = ?(10 分)
#570153
三、圖 三 為 一 個 npn 雙 載 子 接 面 電 晶 體 ( BJT ) 疊 接 放 大 器 ( Cascode Amplifier)電路,電晶體 Q1 與 Q2 皆工作在主動模式(Active Mode) 下。為計算方便,未顯示其偏壓電路,但已知 IC2 = 1 mA。電晶體 Q1 與 Q2 的參數如下:β1 = β2 =100,VA1 = VA2 = 150 V,VT1 = VT2 = 25 mV, Cπ1 = Cπ2 = 15 pF,Cμ1 = Cμ2 = 0.3 pF,CS1 = CS2 = 0。電路部分,Rsig = 2 kΩ, RL = 4 kΩ,CL = 20 pF。請計算中頻增益 AM 與上 3dB 頻率 fH。(25 分)
#570152
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