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96年 - 96 專利商標審查特種考試_三等_資訊工程：數位系統導論#50335
科目：
數位系統導論 |
年份：
96年 |
選擇題數：
0 |
申論題數：
11
試卷資訊
所屬科目：
數位系統導論
選擇題 (0)
申論題 (11)
⑴請將十進位數“125.65625”轉換成十六進位數。（4 分）
⑵若奇同位位元（odd parity bit）置於最高位元，請寫出“1010101”結合奇同位位元 的結果並說明此技術有何用途。（6 分）
二、請以最少數量的 NOR 閘且不使用其它邏輯閘的條件下分別設計出與 NOT、OR 和 AND 等邏輯閘的等效電路。（15 分）
【已刪除】 ⑴以積之和（sum of product）最簡化式表示 F
1
(A, B, C )=
。（5 分）
⑵以和之積（product of sum）最簡化式表示 F
2
(A, B, C, D)=Σm(0, 1, 2, 5, 8, 9, 10)。 （5 分）
⑶以積之和最簡化式表示 F
3
(A, B, C, D)=ΠM(1, 3, 4, 6, 9, 11, 12, 14)。（5 分）
⑷若隨意條件（Don’t care condition）d(A, B, C, D)＝Σm(0, 4, 5, 14)以積之和最簡化 式表示 F
4
(A, B, C, D)＝Σm(1, 2, 3, 8, 10)。（5 分）
【已刪除】四、請僅使用一個圖一的 3 對 8 的解碼器（Decoder）及兩個 OR 閘設計“一位元全加器”。 （10 分）
【已刪除】五、請僅使用一個圖二的 4 對 1 的多工器（Multiplexer）及一個 NOT 閘設計可以執行 布林函數 F
5
(A, B, C)＝ΠM (0, 3, 4, 5)的電路。（15 分）
六、請結合一個 OR 閘、一個 NOT 閘、二個 AND 閘及一個 D 型正反器（Flip-flop）設 計一與 JK 型正反器等效的循序電路（sequential circuit）。（15 分）
七、請利用解碼器及多個如圖三的 64K×8RAM 組合出 256×8RAM。（15 分）
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。（5 分） 
