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105年 - 105 國立中山大學_碩士班招生考試_資工系(甲、乙組)：計算機結構#105824
> 申論題
題組內容
2. Cache
2.3 Give two methods to reduce cache miss penalty.
相關申論題
1.1 Explain the major features of single instruction multiple data (SIMD) processor. In other words, point out the major differences between SIMD CPU and conventional CPU. Give a practical example of SIMD instructions, CPU, or computer.
#450861
1.2 Compare the differences of thread and process. Is context switching the change of threads or the change of process?
#450862
1.3 Explain the major features of single instruction multiple threads (SIMT) processor. Give a practical example of SIMT computer.
#450863
1.4 Explain the major features of very long instruction word (VLIW) processor. Which processor category does VLIW belong to, static multiple issue or dynamic multiple issue?
#450864
1.5 What is a superscalar processor? What is a superpipeline processor?
#450865
2.1 Give two methods to reduce cache miss rate.
#450866
2.2 Give two methods to reduce cache hit time.
#450867
2.4 For the following Figure 1, explain the reason why the miss rate goes down as the block size increases to a certain level, and explain the reason why the miss rate goes up if the block size is too large relative to the cache size.
#450869
2.5 Explain the differences of write-allocate and no-write-allocate during cache write miss.
#450870
3.1 What is the cycle time of the pipelined CPU? What is the maximum working frequency?
#450871
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