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103年 - 103 國立中山大學_碩士班招生考試_資工系(甲、乙組):計算機結構#105837
> 申論題
題組內容
3.True or False Questions:
(1)NaN in IEEE 754 can be the result of dividing 0 by 0 (0/0).
相關申論題
(a) How many times is instruction memory accessed? How many times is data memory accessed? (Count only accesses to memory, not registers.)
#450986
(b) What are the addressing modes used in the four instructions?
#450987
(a) What is the clock cycle time if the only types of instructions we need to support are ALU instructions (ADD, AND, etc.)?
#450988
(b) What is the clock cycle time if we only have to support LW (load word) instructions?
#450989
(e) What is the clock cycle time if we must support ALU, branch, load/store instructions? (Hint: You need to find the overall latencies of the blocks in the longest path required to execute an instruction.)
#450990
(a) What is the clock cycle time in a pipelined and non-pipelined processor?
#450991
(b) What is the total latency of an LW instruction in a pipelined and non-pipelined processor? (5%)
#450992
(a) Indicate dependences and their type.
#450993
(b) Assume there is no forwarding in this pipelined processor. Indicate hazards and add NOP instructions to eliminate them.
#450994
(a) Consider a direct-mapped cache with 16KB of data and 16-byte blocks, assuming a 32-bit 300ps address. What is the length of the tag field? How many total bits are required, assuming a valid bit is used?
#450995
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