6 如圖，CMOS 場效電晶體的輸入端 vI 接地時，其輸出端 vo 是處於下列何種狀態？
(A)拉上（pull-up）至 VDD
(C)V_DD/2
(B)拉下（pull-down）至地
(D)QP 與 QN 皆關閉，輸出浮接

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統計： A(99), B(22), C(20), D(13), E(0) #2128711

100006037050357

B2 · 2020/01/03

#3729673

此為cmos反向器輸出只有0(low)或...

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pole~zero

B1 · 2019/12/27

#3723201

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Alice

2025/11/21

私人筆記#7577017

未解鎖

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6 如圖，CMOS 場效電晶體的輸入端 vI 接地時，其輸出端 vo 是處於下列何種狀態？ (A)拉上（pull-up）至 VDD (C)VDD/2 (B)拉下（pull-down）至地 (D)QP 與 QN 皆關閉，輸出浮接